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基于CPLD/FPGA的呼吸灯效果实现（附全部verilog源码）
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毡轩
CW信号的正交解调
1.CW信号   CW可以叫做等幅电报，它通过电键控制发信机产生短信号"."（点）和长信号"--"（划），并利用其不同组合表示不同的字符，从而组成单词和句子。   ...
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啤愿
使用verilog生成各种CRC校验码
一、功能介绍 在FPGA进行各种接口通信时，经常会出现对方发来的数据带有CRC校验码，如CRC5、CRC8、CRC16、CRC32等，为了适应不同的情况，我们使用Verilog实现了 ...
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FPGA内部资源（一）DSP48E1
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樊涵菡
搭建verilog/systemverilog学习环境
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忙贬
用verilog/systemverilog 设计fifo (2)
目录 [*]异步fifo实现中要解决的问题 [*]信号同步到那个时钟域 [*]读写指针转化为格雷码 [*]格雷码表示的读写地址如何判断空满？ [*]异步fifo verilog代码 ...
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阙忆然
Scala基本语法
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PM的正交解调法
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FPGA对EEPROM驱动控制（I2C协议）
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叶芷雁
FM的正交解调法
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忿媚饱
Scala集合
集合 scala中的集合分为两种 ,可变集合和不可变集合, 不可变集合可以安全的并发的访问! 集合的类主要在一下两个包中 [*]可变集合包 scala.collection.mutab ...
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恙髡
Scala高阶语法
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辉伫
scala异常和IO
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IDocList/IDocDict JSON for Delphi and FPC
IDocList/IDocDict JSON for Delphi and FPC 【英文原文】 多年来，我们的开源 mORMot 框架提供了多种方法来处理在运行时定义的数组/对象文档的任意组合，例如 ...
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兜蛇
Scala语法篇
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Quick Logger 强大的企业级异步记录器
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移国拱
SynProject 介绍---（synopse理解的版本控制和文档自动化生成）
SynProject 介绍---（synopse理解的版本控制和文档自动化生成） Synopse SynProject是一个用于Delphi项目的源代码版本控制和自动化文档生成的开源应用程序。它 ...
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瞧蛀
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