锟及 发表于 2025-12-29 02:05:00

yosys工具

ysyx的yosys工具（12.28综合到网表）
yosys工具使用

执行下面命令（粗粒度，yosys使用字级单元表示）
read_verilog counter.v
//细化
hierarchy -check -top counter
//查看rtl视图
show
//粗粒度综合
proc
//优化
opt
//执行fsm,memory 视图是不变的show命令后显示如下图片，这个时候存在过程块proc

执行proc后，过程块消失，全部有小的cell表示

执行opt命令，结果表示单元数目显著减少

执行下面命令（细粒度，yosys使用门级电路表示）
//转换为门电路
techmap
//对一些多位的线网和端口进行拆分, 否则RTLIL中将会包含不必要的位抽取和位拼接操作
splitnets -ports
//一定要执行opt -full，否则无法show（原因是因为节点太多无法显示）
opt -full
执行下面命令（工艺映射）,先创建个cell.lib
dfflibmap -liberty cell.lib
执行下列命令，先读入规则
read_liberty -lib cell.lib
继续执行
abc -liberty cell.lib
clean
至此，完成从RTL代码到网表的转换.
//保存网表文件
write_verilog netlist.v
//输出报告
stat -liberty cell.lib
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舒菀菀 发表于 2026-1-4 02:30:53

感谢分享，学习下。

挡缭 发表于 2026-1-5 15:31:36

不错，里面软件多更新就更好了

诈知 发表于 2026-1-10 08:50:27

很好很强大我过来先占个楼 待编辑

骆贵 发表于 2026-1-14 04:18:55

这个有用。

莠畅缕 发表于 2026-1-15 11:37:14

新版吗？好像是停更了吧。

疝镜泛 发表于 2026-1-15 15:11:29

过来提前占个楼

孜稞 发表于 2026-1-15 19:20:58

谢谢分享，试用一下

羊夏菡 发表于 2026-1-18 12:36:07

感谢分享，学习下。

狭踝仇 发表于 2026-1-19 02:15:18

喜欢鼓捣这些软件，现在用得少，谢谢分享！

柄利 发表于 2026-1-21 15:58:29

感谢发布原创作品，程序园因你更精彩

铝缉惹 发表于 2026-1-21 17:30:40

感谢分享

鞭氅 发表于 2026-2-4 06:51:23

感谢分享

章娅萝 发表于 2026-2-7 04:15:32

感谢，下载保存了

遑盲 发表于 2026-2-7 04:44:56

分享、互助 让互联网精神温暖你我

甦忻愉 发表于 2026-2-8 08:34:00

用心讨论，共获提升！

豌畔丛 发表于 2026-2-8 14:37:51

过来提前占个楼

崔和美 发表于 2026-2-8 17:32:59

感谢，下载保存了

劳暄美 发表于 2026-2-9 02:43:24

懂技术并乐意极积无私分享的人越来越少。珍惜

挠溃症 发表于 2026-2-9 06:39:17

新版吗？好像是停更了吧。
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